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XCV600E-6HQ240I - xilinx - Virtex™-E 1.8V 필드 프로그램이 가능한 게이트 어레이

XCV600E-6HQ240I - xilinx - Virtex™-E 1.8V 필드 프로그램이 가능한 게이트 어레이

    • XCV600E-6HQ240I - xilinx - Virtex™-E 1.8V Field Programmable Gate Arrays
    • XCV600E-6HQ240I - xilinx - Virtex™-E 1.8V Field Programmable Gate Arrays
  • XCV600E-6HQ240I - xilinx - Virtex™-E 1.8V Field Programmable Gate Arrays

    제품 상세 정보:

    원래 장소: 필리핀
    브랜드 이름: xilinx
    인증: Lead free / RoHS Compliant
    모델 번호: XCV600E-6HQ240I

    결제 및 배송 조건:

    최소 주문 수량: 1
    가격: Contact for Sample
    포장 세부 사항: 견본을 위한 접촉
    배달 시간: 삼일 이내
    지불 조건: 미리 T/T, Paypal, 서부 동맹
    공급 능력: 5000
    지금 연락
    상세 제품 설명
    하이 라이트:

    programmable ic chips

    ,

    integrated circuit chips

    빠른 세부사항:
    Virtex™-E 1.8 V 필드 프로그램이 가능한 게이트 어레이
    묘사:
    Virtex-E FPGA 가족은 고성능의, 대용량 풀그릴 논리 해결책을 전달합니다. 실리콘 효율성에 있는 급격한 증가는 장소 그리고 노선 효율성을 위한 새로운 건축술 낙관에서 유래하고 공격적인 6 층을 이용해서 0.18 μm CMOS 과정을 금속을 붙이십시오. 이 전진은 가면 프로그램한 게이트 어레이에 Virtex-E FPGAs를 강력하고 가동 가능한 대안 만듭니다. Virtex-E 가족은 도표 1.에 9명의 일원을 포함합니다.
    Virtex FPGAs에서 주어진 경험에 건물은 풀그릴 논리 디자인에서, Virtex-E 가족 앞으로 진화 단계입니다. 빠른, 가동 가능한 내부 연락 자원, 그리고 진보된 공정 기술의 다양한 풀그릴 시스템 특징, 부유한 계층구조를 결합해서, Virtex-E 가족은 시간에 시장을 감소시키고 있는 동안 디자인 융통성을 강화하는 고속과 대용량 풀그릴 논리 해결책을 전달합니다.
    신청:
    • 빠른, 고밀도 1.8 V FPGA 가족
    - 58 k에서 4개 M 체계 문에 조밀도
    - 130 MHz 내부 성과 (4개의 LUT 수준)
    - 저전력 가동을 위해 디자인하는
    - PCI 고분고분한 3.3 V의 32/64 조금, 33/66 MHz
    • 높게 가동 가능한 SelectI/O+™ 기술
    - 지원 20의 고성능 공용영역 기준
    - 804까지 > 100 Gb/s의 총계 대역폭을 위한 I/Os 또는 344의 차별 입력/출력 쌍을 골라내 끝났습니다
    • 차별 신호 지원
    - LVDS (622 Mb/s), BLVDS (버스 LVDS), LVPECL
    - 차별 입력/출력 신호는 또는 입력/출력, 산출 입력될, 수 있습니다
    - 표준 차별 장치와 호환이 되는
    - 300+ MHz를 위한 LVPECL와 LVDS 클럭 입력은 시간을 잽니다
    • SelectLink™ 소유 고성능 기술
    - Virtex-E 연결에 두 배 전송율 (DDR)
    - 웹기반 HDL 세대 방법론
    • 정교한 SelectRAM+™ 기억 계층구조
    - 내부 구성 분배된 렘의 1 메가비트
    - 동시 내부 구획 렘의 832까지 킬로 비트
    - BlockRAM 진실한 듀얼포트 기능
    - 1.66 Tb/s (100개의 RAMBUS 수로 이상의 동치 대역폭)까지 기억 대역폭
    - 외부 기억에 고성능 공용영역을 위해 디자인하는
    - 200 MHz ZBT* SRAMs
    - 200 Mb/s DDR SDRAMs
    - 자유로운 Synthesizable 참고 디자인에 의해 지원하는
    • 고성능 붙박이 시계 관리 회로
    - 8개의 완전히 디지털 방식으로 지연 고정 되는 반복 (DLLs)
    - 전송율 (DDR) 두 배 신청을 위한 디지털 방식으로 종합된 50% 의무 주기
    - 시계는 곱하고 분할합니다
    - 고속 LVPECL/LVDS의 0 지연 변환은 어떤 입력/출력 기준든지에 시간을 잽니다
    • 속도와 조밀도가 가동 가능한 건축술에 의하여 균형을 잡습니다
    - 열성 고속 산법을 위한 논리를 나르십시오
    - 열성적인 승수 지원
    - 넓 입력 기능을 위한 폭포 사슬
    - 시계에 풍부한 등록/래치는, 및 이중 동시/비동시성 세트 및 리셋 가능하게 합니다
    - 내부에게 3 국가 버스로 가기
    - IEEE 1149.1 경계 검사 논리
    - 거푸집 온도 감지기 다이오드
    • Xilinx Foundation™와 연립 Series™ 개발 시스템에 의해 지원하는
    - 50%의 컴파일 시간 감소를 더
    - 문 조밀도 백만 플러스를 위한 인터넷 팀 디자인 (ITD) 공구 이상은 디자인합니다
    - PC와 워크스테이션 플랫폼의 다양한 종류
    • SRAM 근거한에서 체계 윤곽
    - 무제한 재 programmability
    • 진보된 포장 선택권
    - 0.8 mm 칩 가늠자
    - 1.0 mm BGA
    - 1.27 mm BGA
    - HQ/PQ
    • 0.18 μm 6 층 금속 과정
    • 시험되는 100%년 공장
    명세:

    자료표

    Virtex-E 1.8V

    PCN 진부화

    XC1700, 5200, HQ의 SCD 가족 19/Jul/2010

    표준 패키지

    1

    종류

    직접 회로 (ICs)

    가족

    끼워넣는 - FPGAs (필드 프로그램이 가능한 게이트 어레이)

    시리즈

    Virtex®-E

    실험실/CLBs의 수

    3456

    논리 성분/세포의 수

    15552

    총 렘 조금

    294912

    I /O의 수

    158

    문의 수

    985882

    전압 - 공급

    1.71 V ~ 1.89 볼트

    설치 유형

    지상 산

    작용 온도

    -40°C ~ 100°C

    포장/케이스

    240-BFQFP에 의하여 드러내는 패드

    공급자 장치 포장

    240-PQFP (32x32)

     
    경쟁 이점:
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