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CY37128P84-100JC - Cypress 반도체 - 5V, 3.3V, ISR™ 고성능 CPLDs

CY37128P84-100JC - Cypress 반도체 - 5V, 3.3V, ISR™ 고성능 CPLDs

CY37128P84-100JC - Cypress Semiconductor - 5V, 3.3V, ISR™ High-Performance CPLDs

제품 상세 정보:

원래 장소: 필리핀
브랜드 이름: Cypress Semiconductor
인증: Lead free / RoHS Compliant
모델 번호: CY37128P84-100JC

결제 및 배송 조건:

최소 주문 수량: 50
가격: Contact for Sample
포장 세부 사항: 견본을 위한 접촉
배달 시간: 삼일 이내
지불 조건: 미리 T/T, Paypal, 서부 동맹
공급 능력: 5000
지금 연락
상세 제품 설명

 

빠른 세부사항:

 

5V, 3.3V의 ISRâ „¢ 고성능 CPLDs

 

 

묘사:

 

CMOS CPLDs의 Ultra37000™ 계열은 비할 데 없는 시스템 성능을 고밀도 풀그릴 논리 해결책의 범위를 제공합니다. Ultra37000 가족은 고밀도 CPLDs에 22V10의 융통성, 사용 용이 및 성과를 가져오기 위하여 디자인됩니다. 건축술은 풀그릴 내부 연락 모체 (PIM)에 의해 연결되는 다수 논리 구획에 근거를 둡니다. 각 논리 구획은 그것의 자신의 제품 기간 배열, 제품 기간 배당자 및 16의 macrocells를 특색짓습니다.

PIM는 논리 구획 산출에서 신호를 배부하고 논리에 모든 입력 핀은 입력을 막습니다.

재프로그램할 수 있는 Ultra37000 장치 전부는 전기로 지울 수 있고습니다 그로 인하여 비용을 삭감하는 디자인과 제조 둘 다 교류를 간단하게 하는 InSystem (ISR), 입니다. ISR 특징은 디자인 변화 원인 pinout가 있고는 또는 변화를 시기를 정하기 없이 장치를 재구성하는 기능을 제공합니다. Cypress ISR 기능은 JTAGcompliant 직렬 인터페이스를 통해서 실행됩니다. 자료는 TDI와 TDO 핀을 통해서, 각각 안으로 그리고 밖으로 이동됩니다. Ultra37000 장치의 우량한 routability 그리고 간단한 시기를 정하는 모형 때문에,

ISR는 동시에 pinout 지정과 유지 고치고 있는 동안 시스템 성능 사용자가 기존하는 논리 디자인을 바꾸는 것을 허용합니다.

ISR와 경계 검사를 위한 전체 가족 특징 JTAG는, 그리고 전기와 시기를 정하는 요구에 응하는 PCI 시내 버스 명세와 호환이 됩니다. Ultra37000 가족은 사용자 모든 I/Os에 풀그릴 버스 파악 기능을 특색짓습니다.

Ultra37000 장치가 5V 공급으로 운영하고 5V 또는 3.3V 입력/출력 수준을 지원할 수 있는 Ultra37000 5.0V 장치. VCCO 연결은 5V 또는 3.3V에 조화시키기의 기능을 버스 제공합니다. 연결해서 VCCO는 사용자가 산출에 5V TTL 수준을 확실히 하는 5V에 핀으로 꼿습니다. VCCO가 3.3V에 연결되는 경우에 출력 레벨은 3.3V JEDEC 표준 CMOS 수준에 도달하고 관대한 5V입니다.

이 장치는 5V ISR 프로그램을 요구합니다. Ultra37000V 3.3V 장치

3.3V 공급으로 작동하는 장치는 장치의 전력 소비를 감소시키는 모든 VCCO 핀에 3.3V를 요구합니다. 이 장치는 3.3V JEDEC 표준 CMOS 출력 레벨을 지원하고, 5V 관대합니다. 이 장치는 3.3V ISR 프로그램을 허용합니다.

 

 

신청:

 

• 에서 체계 Reprogrammable™ (ISR™) CMOS CPLDs

— reconfigurability를 위한 JTAG 공용영역

— 디자인 변화는 pinout 변화를 일으키는 원인이 되지 않습니다

— 디자인 변화는 타이밍 변화를 일으키는 원인이 되지 않습니다

• 고밀도

— 32에서 512의 macrocells

— 32에서 264의 입력/출력 핀

— 4개의 시계 핀을 포함하여 5개의 열성적인 입력

• 간단한 시기를 정하는 모형

— 팬-아웃 지연 없음

— 확대기 지연 없음

— 입력/출력 핀 지연 대 아니 열성

— PIM를 통해 추가 지연 없음

— 16의 제품 기간을 충분히를 사용하는을 위한 형벌 없음

— 제품 기간 조타하거나 공유하기를 위한 지연 없음

• 3.3V와 5V 버전

• PCI 양립한 [1개]

• 모든 I/Os에 풀그릴 버스 파악 기능

• 지적인 제품 기간 배당자는 제공합니다:

— 어떤 macrocell에 0개에서 16의 제품 기간

— 개별적으로 조타하는 제품 기간

— 국부적으로 macrocells 중 공유하는 제품 기간

• 가동 가능한 시간을 재기

— 장치 당 4개의 동기 클럭

— 제품 기간 시간을 재기

— 논리 구획 당 시계 극성 통제

• 모든 조밀도의 맞은편에 제안하는 일관된 포장/pinout

— 디자인 이동을 간단하게 합니다

— 3.3V와 5.0V 장치를 위한 동일한 pinout

• 포장

— PLCC, CLCC, PQFP, TQFP, CQFP, BGA 및 정밀하 피치 BGA 포장에 있는 44에서 400의 지도

 

 

명세:

 

부품 번호.

CY37128P84-100JC

제조자

Cypress 반도체

공급 능력

10000

datecode

10+

포장

BGA

새로운 본래 주식

 

 

경쟁 이점:

 

보장: 180 일!
자유로운 선박: $1000 승리 이상 순서 자유로운 선적 요금
(3Kg의 밑에 상품 무게), 20130901-20130930 도중.


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