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TMS320C6748-DEV 발달 널, 디지털 방식으로 DSP LSI 회로판

TMS320C6748-DEV 발달 널, 디지털 방식으로 DSP LSI 회로판

TMS320C6748-DEV Development Boards , Digital DSP LSI Circuit Board

제품 상세 정보:

원래 장소: CN
인증: Lead free / RoHS Compliant
모델 번호: TMS320C6748-DEV

결제 및 배송 조건:

최소 주문 수량: 1 PC
가격: Contace sales group 1
포장 세부 사항: 표준 포장
배달 시간: 2-3 일
지불 조건: T/T Paypal, 서부 동맹, 조건부 날인 증서 등등, L/C
공급 능력: 1000
지금 연락
상세 제품 설명

TMS320C6748-DEV 발달 널, 디지털 방식으로 DSP LSI 회로판 

 

 

 

TMS320C40: 고성능 부동 소수점 디지털 신호 처리기 (DSP)

– '320C40-60: 33 ns 명령 주기 시간, 330대의 MOPS, 60 MFLOPS, 30 MIPS, 384M 바이트/s

– '320C40-50: 40 ns 명령 주기 시간

– '320C40-40: 50 ns 명령 주기 시간

6개의 통신 포트


6 수로 직접 기억 장치 접근 (DMA) Coprocessor

IEEE-754 부동 소수점 체재 에서부터/로 단 하나 주기 변환

단 하나 주기, 1/x, 1/SQRT (x)

TMS320C3x와 호환이 되는 근원 부호

부동 소수점 단 하나 주기 40 조금, 32 비트 정수 승수

12개 40 조금 기록기, 8개의 보조 기록기, 14의 제어 레지스터 및 2개의 타이머

양립한 IEEE 1149.1 (JTAG) 경계 검사

공동 메모리 시스템 및 높은 자료 비율의 단 하나 주기 이동을 지원하는 2개의 동일한 외부 데이터와 주소 버스:

   – 120M Bytes/s ('C40-60)의 높은 항구 자료 비율 (각 버스)

   – 16G 바이트 연속 프로그램 자료/주변 주소 공간

   – 빠른, 지적인 버스 중재를 위한 기억 접근 요구

   – 분리되는 주소 버스, 자료 버스는, 핀을 통제 가능하게 합니다

   – 기억 통제 신호 지원 기계설비에 있는 다른 속도 기억의 4 세트

325 Pin 세라믹 격자 배열 (GF 접미어)

0.72-μm를 사용하여 날조해 텍사스 인스투르먼트 (TI)에 의하여 성과에 의하여 이식된 CMOS (EPIC) 기술을 강화했습니다

소프트웨어 커뮤니케이션 항구 리셋

중앙 처리 장치 (CPU) 지탱된 성과를 확대하는 프로그램과 데이타 처리량의 다량 동시 입출력 (I/O)의 지원의 분리되는 내부 프로그램, 데이터 및 DMA Coprocessor 버스

증가된 기억 접근 성과를 위한에 칩 프로그램 시렁 및 이중 접근/단 하나 주기 렘

   – 512 바이트 지시 시렁

   – 단 하나 주기 이중 접근 프로그램 또는 자료 렘의 8K 바이트

   – 8, 16-, 또는 32 비트를 사용하는 ROM 근거한 부트 로더 지원 프로그램 Bootup

통신 포트의 기억 또는 한

IDLE2 시계 정지 힘 아래로 형태

5-V 가동

 

 

경쟁 이점:

 

보장: 모든 상품을 위한 180days

자유로운 선박: $600 승리 이상 순서 자유로운 선적 요금: 상품은 3Kg의 밑에 무겁게 합니다.

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